new file mode 100644
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+/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
+/*
+ * Copyright (c) 2022 Samsung Electronics Co., Ltd.
+ * Author: Chanho Park <chanho61.park@samsung.com>
+ *
+ * Device Tree binding constants for Exynos Auto V9 clock controller.
+ */
+
+#ifndef _DT_BINDINGS_CLOCK_EXYNOSAUTOV9_H
+#define _DT_BINDINGS_CLOCK_EXYNOSAUTOV9_H
+
+/* CMU_TOP */
+#define FOUT_SHARED0_PLL 1
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+#define FOUT_SHARED2_PLL 3
+#define FOUT_SHARED3_PLL 4
+#define FOUT_SHARED4_PLL 5
+
+/* MUX in CMU_TOP */
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+
+/* DIV in CMU_TOP */
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+
+/* GAT in CMU_TOP */
+#define GOUT_CLKCMU_CMU_BOOST 201
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+#define TOP_NR_CLK 249
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+#define BUSMC_NR_CLK 4
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+/* CMU_CORE */
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+#define CORE_NR_CLK 5
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+/* CMU_FSYS2 */
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+
+#define FSYS2_NR_CLK 7
+
+/* CMU_PERIC0 */
+#define CLK_MOUT_PERIC0_BUS_USER 1
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+#define PERIC0_NR_CLK 42
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+/* CMU_PERIC1 */
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+#define PERIC1_NR_CLK 42
+
+/* CMU_PERIS */
+#define CLK_MOUT_PERIS_BUS_USER 1
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+#define CLK_GOUT_WDT_CLUSTER1 4
+
+#define PERIS_NR_CLK 4
+
+#endif /* _DT_BINDINGS_CLOCK_EXYNOSAUTOV9_H */